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MAX5306/MAX5307
Power-Supply Considerations
On power-up, all input and DAC registers are cleared
and DOUT is in low.
Bypass VDD to GND with a 4.7F capacitor in parallel
with a 0.1F capacitor. Use short lead lengths and
place the bypass capacitors as close to the supply
pins as possible.
Low-Power, Low-Glitch, Octal 12-Bit Voltage-
Output DACs with Serial Interface
12
______________________________________________________________________________________
SCLK
X
1
2
3
4
16
D1
D12
D14
X
DIN
X
DOUT
D14*
D13*
D12*
D1*
CS
tCSH
tCL
tDH
tDS
tCSS
tCH
tSDL
tSDH
tCSPWH
D0
D0*
D15*
D15
D13
*PREVIOUS INPUT DATA
±0.5LSB
VOUT_
tCLRPWL
tLDACPWL
tS
CLR
LDAC
Figure 4. Timing Diagram
DAC CONTENTS
ANALOG OUTPUT
MSB
LSB
2047
1111
+VREF ( ——— )
2048
1
1000
0000
0001
+VREF ( ——— )
2048
1000
0000
0V
1
0111
1111
-VREF ( ——— )
2048
2047
0000
0001
-VREF ( ——— )
2048
0000
-VREF ( ——— ) = -VREF
2048
DAC CONTENTS
ANALOG OUTPUT
MSB
LSB
4095
1111
+VREF ( ——— )
4096
2049
1000
0000
0001
+VREF ( ——— )
4096
2048
+VREF
1000
0000
+VREF ( ——— ) = ————
4096
2
2047
0111
1111
+VREF ( ——— )
4096
1
0000
0001
+VREF ( ——— )
4096
0000
0V
Table 3. Unipolar Code Table
Table 4. Bipolar Code Table
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